Show Time! 第二届 RISC-V 中国峰会/开源 EDA 研讨会，兆松硬核技术/数据呈现预告

2022年8月23日 · 阅读需 23 分钟

异构计算芯片的核心问题是软硬件协同，在本次第二届中国 RISC-V 峰会/第一届 OSEDA 研讨会，兆松除了展现如何做到近似手写汇编同等性能的自动向量化编译器技术之外，还会针对现有的 RISC-V Vector 扩展提出一些新思路，进一步提升 RISC-V 在 AI 芯片领域的计算力以及通用性（相对于 Systolic Array)，我们硬件编译器组的同事也会分享兆松在数字 EDA 前端仿真加速领域的技术细节和最新进展。

8 月 25 日上午 9:30-10:00 第二届 RISC-V 峰会分会场 B

演讲主题：Scalable Matrix - The Missing Part of RISC-V Scalable Vector

演讲者：伍华林，兆松科技 CTO，曾就职于晶心 (杭州)，S3 Graphics 和 Imagination（英国）公司，拥有十多年 CPU/GPU 编译器和工具链研发经验。

内容简介：RISC-V 开放的标准，以及可变长向量指令集给异构计算领域带来了新的思路，但是和现有的脉冲阵列加速器相比，每瓦性能比又显逊色，我们如何既能做到类似脉冲阵列加速器这样极致的性能功耗比，又能很好的兼容现有的软件编程接口呢？

8 月 25 日早上 10:00-10:30 第二届 RISC-V 峰会分会场 B

演讲主题：Challenges with multi-level loops RISC-V Vector Auto Vectorization in LLVM

演讲者：晏明，兆松科技软件编译器团队核心成员，主要负责数学函数库优化以及 ZCC 编译器当中 RVV 自动向量化实现。

内容简介：LLVM 对于可变长向量的自动产生支持并不完整，特别是对于多层循环的自动向量化，本次技术分享首先给大家科普一下 LLVM 的自动向量化器的现状，以及我们兆松在实现 RVV 多层循环自动向量化的时候遇到的挑战和问题，以及和一些手写 AI 算子的性能对比。

第二届RISC-V中国峰会直播地址已确认:

B站直播：
主会场及分会场A：
https://live.bilibili.com/10339607
主会场及分会场B：
https://live.bilibili.com/22275404

电子发烧友直播：
主会场及分会场 A：
https://t.elecfans.com/live/2096.html
主会场及分会场 B：
https://t.elecfans.com/live/2097.html

微信视频号：
主会场及分会场 A：半导体行业观察
主会场及分会场 B：AI 观察站
RVSC 组委会，公众号：中国开放指令生态 RISCV 联盟
参会者请关注：RISC-V 中国峰会直播地址已公布、观众礼品已经寄出

8 月 28 日下午 16:00-16:30 第一届 OSEDA 研讨会

演讲主题：Accelerate Hardware Simulation with Multi-threaded Method in CIRCT

演讲者：魏子豪，兆松科技硬件编译器团队核心成员，毕业于哈尔滨工业大学，曾就职于华为网络安全中心，目前主要负责基于 CIRCT 的高性能数字 EDA 仿真器设计和研发。

内容简介：复杂 SoC 设计的仿真和验证效率是目前业内所面临的重要问题，兆松目前正在致力于研发开源高性能硬件仿真器来解决这些问题，本次技术分享主要介绍兆松科技在 CIRCT 硬件编译器框架上做的一些技术探索，以及开发高性能硬件仿真器过程当中的一些收获和技术细节 (坑)。

第一届 OSEDA 研讨会的议程现已确认，欢迎大家报名参会:

腾讯网络研讨会会议号：702 725 743

OSEDA，公众号：CNRV
第一届 OSEDA 研讨会的议程公布

https://riscv-summit-china.com/cn/agenda.html

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兆松科技是一家专业做编译和仿真的初创公司，由前晶心科技研发副总王东华博士于 2019 年底创立。研发总监伍华林曾就职于晶心科技，S3 Graphics，Imagination，拥有 10 余年 CPU/GPU 编译器研发经验。欢迎关注兆松科技公众号！